数字相机用CCD信号处理器

2006-05-07 15:50:18来源: 电子产品世界

CCD(电荷耦合器件)信号处理器VSD2100是一款完整的数字相机IC,它为CCD阵列输出提供信号调理和10位A/D变换。它所提供的CCD信号处理包括:从像素获取视频信息的相关双取样(CDS);与供变化的照明度条件用的数字控制相当的0d到+34dB增益;为得到精确黑色基准的黑色电平箝位。该主信号处理器的特性包括53dB SNR。其10位A/D变换的变换率达27MHz,而且没有漏代码。低电压(2.7V到3.6V),低功率(2.7V为160mW,3.0为190mW)便携工作。

它的应用包括:视频相机,数字静止相机,PC相机和保密相机。

VSP2100Y功能框图示于图1,其中CCDD:CCD信号输入,CCDR:伪反馈回路外接电容,REFCK:CDS基准取样脉冲,DATCK:CDS数据取样脉冲,WRT:串行数据输入的写脉冲,SD:D/A变换器串行数据输入,SCLK:串行数据输入的时钟,DACOUT:D/A变换器输出,0B:光学黑色箝位脉冲,ADCK:数字数据输出锁存时钟,DRVDD:数字输出(B1~B10)的数字电源。从图1可见,CCD阵列的输出先送到相关双取样器(CDS),然后到有对数控制特性的电压控制衰减器(VCA),并在加到10位A/D变换器输入之后送到输出放大器,采用两个校正周期来降低其失调变化。在伪像素时间期间激励输入自动零电路以清除相关双取样器的失调。在光黑色定时期间用另一个自动零电路来消除与输出放大器有关的失调和来自CDS的剩余失调。

相关双取样器(CDS)去掉来自图像传感器输出的低频噪声。在基准时段期间和数据时段期间对来自CCD阵列的输出取样。用减法消除呈现在输入端,并比像素时段大一个周期的噪声。VSP2100采用一种三track/hold相关双取样器结构(见图2)。Track/Hold2在基准时段期间被REFCK信号取样。Track/Hold3在数据Track/Hold1被DATCK信号取样的相同时间被重新取样。这样做是为了去掉来自Track/Hold2的大的瞬变,这种大的瞬变是跟踪和保持采集时间期间所呈现出的复位瞬变的一部分。Track/Hold3的输出经电压跟随器缓冲。

关键字:处理器

编辑: 引用地址:http://www.eeworld.com.cn/xfdz/2006/0507/2641.html
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