数字视频解码器SAA7110

2011-04-24 11:13:32来源: 互联网 关键字:数字  数字视频  视频  视频解码

视频解码器SAA7110是Philips公司生产的可编程前端视频解码器。与SAA7111相比,两者尽管有些管脚信号相似,但仍有较大的差别,需要在实际应用中给予足够的重视。国内做视频采集或图像采集的大多用SAA7111,而提到较多的SAA7110则未见多少资料对其进行详细论述。在产品生产上,只有个别国内公司(如北京嘉恒中自图像技术有限公司)使用该芯片。基于科研和实践需要,本文对SAA7110的主要特点、结构功能、引脚应用等作一详尽论述。

1 主要特点

SAA7110的主要特点如下:

●具有6路模拟输入(4×CVBS、3×Y/C或二者相结合);

●带有3路模拟处理通道;

●内置3路抗混叠滤波器;

●可将2路通道模拟信号相加;

●内含2路8位CMOS视频A/D转换器;

●对所选择的CVBS/Y通道可编程为静态增益控制或自动增益控制;

●可进行白峰控制;

●可对PAL B/G、NTSC M、SECAM制式进行亮度和色度处理;

    ●可全程HUE控制;

●可自动进行50/60Hz场频检测以及标准PAL和NTSC、强制SECAM之间的自动转换;

●对所有制式可实现行、场同步检测;

●对于PAL制式可用UV信号延迟线来校正色度信号的相差;

●YUV总线支持以下数据率:

—780×fh=12.2727MHz,60Hz(NTSC);

—944×fh=14.75MHz,50Hz(PAL/SECAM);

●数据输出格式有YUV 4:1:1(8bit)和YUV 4:2:2(8bit)两种;

●用户可编程进行亮度峰值孔径修正;

●所有制式可用同一频率电路晶振(26.8MHz);

●具有实时状态信息输出(RTCO);

图2

    ●可对YUV总线进行亮度、对比度、饱和度(BCS)控制;

●输出引脚有一个用户可编程通用转换开关;

●在片可进行时钟产生电路(CGC)和外部CGC(SAA7197)之间的转换;

●具有上电控制功能;

●带有可控制的I2C总线;

●与CCIR601标准兼容。

2 结构原理及引脚功能

2.1 结构原理

SAA7110的功能框图如图1所示。下面对方框图中的主要部分进行功能说明。

(1)模拟输入处理

SAA7110有6路模拟信号输入,2个模拟主通道有箝位电路、模拟放大器、抗混叠滤波器、视频CMOS A/D转换器组成。另一路模拟通道也含有箝位电路、模拟放大器、抗混叠滤波器,且能被加到或在A/D转换前直接转换到两个主通道上。

    (2)模拟控制电路

箝位控制电路控制着模拟输入信号的正确箝位。高频耦合电容器用于存储和过滤箝位电压。对于亮度或CVBS信号,通常的数字箝位标准是64,而色度信号则是128。增益控制电路通过总线产生3路模拟放大器的静态增益标准,也可以通过内置的自动增益控制(AGC)电路控制其中的一路。AGC的作用是将CVBS或Y信号放大到所需的信号幅值,以使之与ADC输入电压范围相同。抗混叠滤波器要适合于时钟频率。垂直消隐控制电路用于产生总线可编程垂直消隐脉冲。在垂直消隐期间,增益和箝位控制无效。

(3)色度电路

8位数字色度信号经过输入接口后可通过色度带通滤波器来减少直流分量,然后送到正交解调器的乘法输入端。在来自局部振荡器DTO1(离散时间振荡器)的2个副载波信号中,副载波信号的相位偏移为90°,频率则由当前所输入视频信号的色彩制式所决定。对于所有PAL和NTSC信号,乘法器可作为正交解调器来使用;而对于SECAM信号,乘法器则作为降频混频器来使用。两个乘法输出信号转换为连续的UV数据流后,可用于2个低通滤波器级,然后再加到增益可控放大器。最后的一个多路复用低通滤波器将与前级一起用来设置所需的带宽。PAL和NTSC原始信号流入梳状滤波器。SECAM原始信号则通过钟形滤波器(中心频率为0Hz)、相位解调器和微分器来馈送以获得频率解调的色差信号。将SECAM信号去加重后馈送到交叉转换中,可产生连续传输的色差信号。这些信号送到BCS(亮度、对比度、饱和度)处理后,它们将最终到达输出格式级和输出接口。图2所示是色度电路的工作过程图。

(4)亮度电路

8位亮度信号(数字CVBS格式或亮度格式(S-VHS、HI8))通过可变换的前置滤波器来馈送。高频分量的增强可以弥补损耗。色度陷波器(fc=4.43 MHz或3.58MHz,中心频率可选)可消除大多数色彩载波信号,因此,S-Video(S-VHS,HI8)信号必须正常通过。亮度信号的高频分量能够在两个具有可选传输性质的带通滤波器中得到增强(通过I2C总线控制锐度增加)。并能在可选的核心电路中再一次增强信号,然后将该信号加入原始(未提升)信号中。增强的亮度信号通过可变延迟馈送到BCS控制和输出接口。

(5)数字YUV总线

通过16bitYUV总线可从输出接口将数字信息传送到场存储体、数字彩色空间转换器(SAA7192 DCSC)或者视频增强模数处理器(SAA7165 VEDA2)。这些输出可由FEIN来控制。YUV数据率与LLC2相等。输出信号Y7~Y0是数字亮度信号的bit位。输出信号UV7~UV0是多路复用色差信号(B~Y)和(R~Y)的bit位。格式表中的时间帧是传输一幅完整取样所需的时间。通过HREF信号可控制该时间帧。通过将FEIN置低可获取快速使能。该信号同时可用来控制数字YUV总线的快速切换。而FEIN引脚为高电平时,则会强制将Y和UV输出变为高阻态。

(6)同步处理

当前置滤波后的亮度信号被送到同步级后。同步脉冲经过切分将送到相位检测器,在这里它们与细分的时钟频率相比较,并将其结果输出到环路滤波器,来储存所有的相差信息。可调节的输出信号HCL和HSY则由模拟前端的要求来产生。输出信号HS、VS、PLIN被锁至时间基准标记可确保其位于输入信号和HREF信号之间,这是因为电路的更进一步改进可能会改变整个处理延迟,因而并不推荐将它用在对输入信号的定时要求绝对准确的场合。用环路滤波器驱动一个振荡器可产生行频率控制信号LFCO。

2.2 引脚功能

图3所示是SAA7110的引脚排列图。各主要引脚的功能如下:

SP:测试输入脚,(转换脚)正常操作时,该脚应当接地。

AP:测试输入脚,(动作脚)正常操作时,该脚亦应接地。

RTCO:实时控制输出。该脚用于配合HPLL、FSC-PLL的递增和PAL或SECAM序列信息。

图4

    SA:I2C总线从地址选择输入。在低电平时,若从地址为9CH,则写入;从地址为9DH,则读入。而在高电平时, 从地址为9DH时写入,9FH时读入。

SDA:I2C总线串行数据输入/输出。

SCL:I2C总线串行时钟输入。

VDD,VSS:分别为+5V电源和接地端。

AIXX:模拟输入脚。

AOUT:模拟输出脚。

LFCO:行频控制输出脚;该模拟时钟信号可用于驱动外部CGC;其频率是实际行频(7.375/6.13636MHz)的倍数。

LLC:行锁定时钟输入/输出脚,当CGCE为1,该脚为输出;CGCE为0时,该脚为输入)。

LLC2:行锁定时钟的2分频输入输出;FLLC2=0.5fLLC。CGCE为1时,该脚为输出;CGCE为0时该脚为高阻态)。

CREF:参考时钟输入/输出脚(CGCE=1时输出;CGCE=0时输入)。

RESET:复位信号,低电平有效。

CGCE:CGC使能输入脚,CGCE为1时,在片CGC有效;CGCE为0时,使用外部CGC模式,可使用SAA7197。

HCL:水平箝位输入/输出脉冲,可通过I2C总线PULIO位来编程:PULIO为1时输出;PULIO为0时输入。该信号可用于给模拟输入接口指示高电平箝位时间。通过对I2C 总线寄存器编程可控制高电平的开始和结束(只在输出模式)。

HSY:水平同步输入/输出,可通过I2C总线的PULIO位来编程:PULIO为1时输出;PULIO为0时输入。该信号可送到模拟接口。通过对I2C总线寄存器进行编程可控制高电平的开始和结束(只在输出模式)。

HS:水平同步输出。其正斜率位置可编程控制

PLIN(HL):PAL不输出标识脚,解调PAL信号可发送换行信号 (PLIN=0)或非换行信号(PLI

[1] [2]

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编辑:神话 引用地址:http://www.eeworld.com.cn/mndz/2011/0424/article_7593.html
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