ISSCC:东芝研制出新款触发器,功耗降低77%

2011-02-22 20:07:46来源: EEWORLD

    根据国外媒体报道,东芝日前开发出一种新型触发器电路,使用CMOS工艺,可以有效降低移动设备中的功耗

    “数据显示,该新触发器的功耗较传统触发器降低约77%,而采用该技术的无线局域网芯片的总功耗降低了24%。”根据东芝公司的声明。

    触发器是一种可以存储电路状态的电子元件。最简单的是由两个或非门,两个输入端和两个输出端组成的RS触发器。复杂一些的有带时钟(CLK)段和D(Data)端,在CLK端为高电平时跟随D端状态,而在CLK端变为低电平的瞬间锁存信号的D触发器。更常用的是两个简单D触发器级联而成的在时钟下跳沿锁存信号的边缘D触发器,广泛应用于计数器、运算器、存储器等电子部件。在一个典型的SoC芯片中,需要有10万至1000万个触发器。

    触发器一般都带有时钟缓冲器,而东芝则改变了触发器结构,消除了时钟缓冲器的能耗。

关键字:东芝  ISSCC

编辑:冀凯 引用地址:http://www.eeworld.com.cn/manufacture/2011/0222/article_5678.html
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