时钟分配芯片在高速并行数据采集中的应用

2011-08-25 12:56:00来源: 互联网 关键字:时钟分配芯  高速并行数据采集
1 经典采样理论
    模拟世界与数字世界相互转换的理论基础是抽样定理。抽样定理告诉我们,如果是带限的连续信号,且样本取得足够密(采样率ωs≥2ωM),那么该信号就能唯一地由其样本值来表征,且能从这些样本值完全恢复出原信号。连续时间冲激串抽样如图1所示,其时域波形和相应的频谱如图2所示。

    根据采样定理,如果样本点取得不足(ωs<2ωM,即欠采样),信号的频谱将发生混叠,如图3所示。所以如果要完整地恢复信号,必须保证足够的采样点。

2 多片ADC采样方式
    单片ADC采样是最常见的。调理过的信号通过单片ADC芯片转换成数字信号,供给后续电路进行数字处理。这种采样方式对于一般应用的场合是可以满足要求的,而且器件连接简单,成本低。而在高速采样的场合,只有提高单片ADC芯片的采样率才能满足要求。然而,通常高速ADC芯片都是很昂贵的;而且由于设计制造工艺,以及存储器读写速度的限制,不可能无限制地提高单片ADC的采样率。这就严重限制了单片ADC在高速采样系统中的应用。本文采用多片ADC并行采样的方式来提高系统的实时采样率。

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关键字:时钟分配芯  高速并行数据采集

编辑:什么鱼 引用地址:http://www.eeworld.com.cn/Test_and_measurement/2011/0825/article_3316.html
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