Aldec 发布HES-7 采用Xilinx Virtex-7系列芯片

2012-09-20 18:44:46来源: 21ic 关键字:Aldec  HES-7
   

Aldec 发布HES-7 新产品,进军ASIC Prototyping市场

采用Xilinx Virtex-7系列芯片,HES-7 可扩充至96M ASIC Gate 容量

Aldec, Inc.今日正式发布HES-7新产品,HES-7原型验证板基于Xilinx Virtex-7芯片设计而成,其设计容量可从4MG扩充至96MG,单一HES-7原型验证板的最大容量为24MG(V7-2000T*2)。藉由Aldec公司所提供的高速背板连结可达96MG设计容量(背板可容纳4片原型验证板)。

“时至今日,SoC/ASIC设计部门已无法再引用过去现成的低容量原型验证系统来完成复杂的设计,越来越多的FPGA芯片将会被要求应用到SoC/ASIC的设计里,耗时的分割设计(partitioning)及不断增加软件工具的支出也愈加困扰着设计部门。”这是Aldec, Inc.硬件设计部总经理Zibi Zalewski所强调的。也因此HES-7原型验证板结合了Xilinx新推出的Virtex-2000T芯片所产生的验证设计平台便应运而生。

“Aldec HES-7新产品将Xilinx Virtex-7芯片及Vivado设计套件充分结合在一起,双方技术的合作将大大提升工程师设计的速度及缩短设计的时程,当然也因此大幅降低了原型设计验证的成本。”这是Xilinx Virtex-7资深产品经理Kirk Saban进一步阐述的。

关键字:Aldec  HES-7

编辑:北极风 引用地址:http://www.eeworld.com.cn/FPGA/2012/0920/article_3175.html
本网站转载的所有的文章、图片、音频视频文件等资料的版权归版权所有人所有,本站采用的非本站原创文章及图片等内容无法一一联系确认版权者。如果本网所选内容的文章作者及编辑认为其作品不宜公开自由传播,或不应无偿使用,请及时通过电子邮件或电话通知我们,以迅速采取适当措施,避免给双方造成不必要的经济损失。

上一篇:Altera发表20奈米SoC FPGA技术蓝图 可降低60%功耗
下一篇:Xilinx 展示电信级All Programmable FPGA和SoC以太网解决方案

关注eeworld公众号 快捷获取更多信息
关注eeworld公众号
快捷获取更多信息
关注eeworld服务号 享受更多官方福利
关注eeworld服务号
享受更多官方福利
推荐阅读
全部
Aldec
HES-7

小广播

独家专题更多

东芝在线展会——芯科技智社会创未来
东芝在线展会——芯科技智社会创未来
2017东芝PCIM在线展会
2017东芝PCIM在线展会
TI车载信息娱乐系统的音视频解决方案
TI车载信息娱乐系统的音视频解决方案
汇总了TI汽车信息娱乐系统方案、优质音频解决方案、汽车娱乐系统和仪表盘参考设计相关的文档、视频等资源

夏宇闻老师专栏

你问我答FPGA设计

北京航空航天大学教授,国内最早从事复杂数字逻辑和嵌入式系统设计的专家。

电子工程世界版权所有 京ICP证060456号 京ICP备10001474号 电信业务审批[2006]字第258号函 京公海网安备110108001534 Copyright © 2005-2017 EEWORLD.com.cn, Inc. All rights reserved