交换位技术改进FPGA-PWM计数器性能

2011-05-27 22:16:44来源: EDN

  简单改变FPGA计数器规格使作为DAC功能PWM计数器的纹波降低。

  当需要一些模拟输出和系统中有FPGA时,很可能选择使用如图1的PWM模块和简单低通滤波器。FPGA的输出是固定频率、计数器和数字比较器使占空比可变的典型波形(表1)。

PWM模块和简单低通滤波器

FPGA OUTPUT

  假设高信号使能,计数器每个时钟周期进行计数,PWM输出的频率为时钟频率的2次幂分频。通过连接前置比例器,使用使能来降低输出频率。由于输出频率固定,滤波器容易计算。已知占空比50%时,出现最坏的纹波。最大纹波和上升时间的限制结合决定滤波器类型和RC(电阻/电容)值。

[1] [2]

关键字:交换位技术  FPGA-PWM

编辑:小甘 引用地址:http://www.eeworld.com.cn/FPGA/2011/0527/article_2165.html
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北京航空航天大学教授,国内最早从事复杂数字逻辑和嵌入式系统设计的专家。

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