28nm Stratix V FPGA抢先解析

2010-04-20 14:00:14来源: EEWORLD

      日前,Altera公布了其28nm Stratix V FPGA的性能参数指标,并透露该款芯片最早发售日期为2011年一季度。

      与Altera Stratix IV及Xilinx Virtex-6对比

      根据已公布的Stratix IV及刚刚公布的Stratix V,我们对于两代产品的性能参数做了一个大致比较。

     

  Stratix V Stratix IV Virtex-6
逻辑单元 1.1M 820K 760K
乘法器 可变精度 18*18 25*18
存储器 53Mbit 23.1Mbits 38 Mbits
串行收发 12.5G背板驱动 28G芯片驱动 11.3G*24 8.5G*48 6.5G*48 11G*24
工艺 28nm 45nm 40nm

      从这张图上我们能看到,Stratix V整体性能较之以往,得到了很大的提升。

      而除了传统性能的提升之外,Stratix V还在其他方面进行了技术革新,其中包括:

      嵌入式HardCopy模块:Altera公司产品及企业市场副总裁Vince Hu解释道,嵌入式HardCopy可以实现定制的IP,密度达到700K逻辑单元,可以通过用户更改硬IP实现更快的产品上市周期。Vince说:“如果重新定制硬IP往往需要12至18个月,而通过对HardCopy模块进行定制的话仅需3至6个月。”

     

      Altera公司产品及企业市场副总裁Vince Hu

      精度可变DSP模块:这次DSP乘法器较之以往的变化确实很大,毕竟FPGA的应用领域不同,对于DSP的需求也不尽相同,因此Stratix V中可为DSP设置多种精度,从9*9至54*54,并且支持浮点计算,根据Vince表示,这是业界第一个支持的厂家。

     

      新的ALM架构:在输入端与Stratix IV并没有区别,而在后端,增加了两个寄存器,可以提升逻辑效率和逻辑性能,“由于很多ALM都被设计为寄存器,因此通过此方法会缩短编译时间,非常适合需要大量流水和丰富寄存器的设计。”Vince说。

     

      28Gbps收发器:芯片至芯片的光传输收发器可以以一半的功耗提供相同的100G带宽。

     

      Stratix V还是延续了以往的命名规则,包括:

• Stratix V GT FPGA——业界唯一面向100G以上系统,集成28-Gbps收发器的FPGA。
• Stratix V GX FPGA——支持多种应用的600-Mbps至12.5-Gbps收发器。
• Stratix V GS FPGA——600-Mbps至12.5-Gbps收发器,适用于高性能数字信号处理(DSP)应用。
• Stratix V E FPGA——适用于ASIC原型开发和仿真以及高性能计算应用的高密度FPGA。

      在硬IP上,目前Altera Stratix V FPGA已经在所有FPGA中实现了集成度最高的硬核IP,提高了器件性能,没有功耗或者成本代价。器件增强功能包括PCIe Gen3, Gen2, Gen1、40G/100G以太网、CPRI/OBSAI、Interlaken、Serial RapidIO® (SRIO) 2.0和万兆以太网(GbE) 10GBASE-R。增强了读/写通路的存储器接口包括DDR3、RLDRAM II和QDR II+。

      下一代应用

     

     

     

相关阅读:

      关于Altera 28nm技术创新请参阅:http://www.eeworld.com.cn/FPGA/2010/0205/article_966.html

关键字:Altera  Stratix  FPGA

编辑:冀凯 引用地址:http://www.eeworld.com.cn/FPGA/2010/0420/article_1089.html
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